Дата последнего обновления файла 21.12.2008

Сумматоры

Двоичные сумматоры позволяют суммировать два двоичных числа и являются основным блоком процессора. При сравнении процессоров наиболее важной характеристикой является разрядность сумматора, входящего в их состав. В современной технике двоичные сумматоры используются в приемопередающей аппаратуре, такой как цифровой тюнер (цифровой ресивер) или в приемниках сотовых аппаратов G3 или LTE.

Построение двоичных сумматоров обычно начинается с сумматора по модулю 2. На рисунке 1 приведена таблица истинности этого сумматора. Ее можно получить исходя из правил суммирования в двоичной арифметике. Предполагается, что читатель знаком с основами двоичной арифметики. Более подробно операции над двоичными числами будут рассмотрены позднее.


Рисунок 1. Таблица истинности сумматора по модулю 2

В соответствии с принципами построения произвольной таблицы истинности, рассмотренными в предыдущей главе, получим схему сумматора по модулю 2. Эта схема приведена на рисунке 2.


Рисунок 2. Принципиальная схема сумматора по модулю 2

Сумматор по модулю 2 (для двоичной арифметики его схема совпадает со схемой исключающего "ИЛИ") изображается на схемах как показано на рисунке 3.


Рисунок 3. Условно-графическое изображение схемы исключающего "ИЛИ"

Сумматор по модулю 2 выполняет суммирование без учета переноса. В полном двоичном сумматоре требуется учитывать перенос, поэтому требуются схемы, позволяющие формировать перенос в следующий двоичный разряд. Таблица истинности такой схемы, называемой полусумматором, приведена на рисунке 4.


Рисунок 4. Таблица истинности полусумматора

В соответствии с принципами построения произвольной таблицы истинности получим схему полусумматора. Эта схема приведена на рисунке 5.


Рисунок 5. Принципиальная схема, реализующая таблицу истинности полусумматора

Полусумматор изображается на схемах как показано на рисунке 6.


Рисунок 6. Изображение полусумматора на схемах

Схема полусумматора формирует перенос в следующий разряд, но не может учитывать перенос из предыдущего разряда, поэтому она и называется полусумматором. Таблицу истинности полного двоичного одноразрядного сумматора можно получить из правил суммирования двоичных чисел. Она приведена на рисунке 7. В обозначении входов использовано следующее правило: в качестве входов использованы одноразрядные числа A и B; перенос обозначен буквой P; для обозначения входа переноса используется буква I (сокращение от английского слова input — вход); для обозначения выхода переноса используется буква O (сокращение от английского слова output — выход).


Рисунок 7. Таблица истинности полного двоичного одноразрядного сумматора

В соответствии с принципами построения принципиальной схемы по произвольной таблице истинности получим схему полного двоичного одноразрядного сумматора. Эта схема приведена на рисунке 8. Ее можно минимизировать, но это несколько усложняет принципы построения сумматоров, поэтому вопросы минимизации рассматриваться не будут.


Рисунок 8. Принципиальная схема, реализующая таблицу истинности полного двоичного одноразрядного сумматора

Полный двоичный одноразрядный сумматор изображается на схемах как показано на рисунке 9.


Рисунок 9 Условно-графическое изображение полного двоичного одноразрядного сумматора

Для того чтобы получить многоразрядный сумматор, достаточно соединить входы и выходы переносов соответствующих двоичных разрядов. Схема соединения одноразрядных сумматоров для реализации четырехразрядного сумматора приведена на рисунке 10.


Рисунок 10. Принципиальная схема многоразрядного двоичного сумматора

Одноразрядные сумматоры практически никогда не использовались, так как почти сразу же были выпущены микросхемы многоразрядных сумматоров. Полный двоичный четырехразрядный сумматор изображается на схемах как показано на рисунке 11.


Рисунок 11. Условно-графическое изображение полного двоичного многоразрядного сумматора

Естественно, в приведенной на рисунке 10 схеме рассматриваются только принципы работы двоичных сумматоров. В реальных схемах никогда не допускают последовательного распространения переноса через все разряды многоразрядного сумматора. Для увеличения скорости работы двоичного сумматора применяется отдельная схема формирования переносов для каждого двоичного разряда. Таблицу истинности для такой схемы легко получить из алгоритма суммирования двоичных чисел, а затем применить хорошо известные нам принципы построения цифровой схемы по произвольной таблице истинности.

Литература:

  1. Микушин А.В., Сажнев А.М., Сединин В.И. Цифровые устройства и микропроцессоры. СПб, БХВ-Петербург, 2010.
  2. Угрюмов Е. П. Цифровая схемотехника. СПб, БХВ-Петербург, 2004.
  3. Шило В. Л. Популярные цифровые микросхемы. М, Радио и связь, 1987.

Вместе со статьей "Двоичные сумматоры" читают:

Мультиплексоры (коммутаторы цифровых сигналов)
http://digteh.ru/digital/MS.php

Синтез комбинационных цифровых схем по произвольной таблице истинности
http://digteh.ru/digital/SintSxem.php

Дешифраторы (декодеры)
http://digteh.ru/digital/DC.php

Шифраторы (кодеры)
http://digteh.ru/digital/Coder.php

Демультиплексоры (коммутаторы цифровых сигналов)
http://digteh.ru/digital/DMS.php


Автор Микушин А. В. All rights reserved. 2001 ... 2015

Предыдущие версии сайта:
http://neic.nsk.su/~mavr
http://digital.sibsutis.ru/

пЕИРХМЦ@Mail.ru


Rambler's Top100